基于HS3282的ARINC429航空通讯总线设计.doc
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1、 基于HS3282的ARINC429航空通讯总线设计摘要: 本文简要地介绍了航空电子通讯总线ARINC429接口的硬件设计和软件算法。系统设计中具有典型性和实用性。关键词:航空电子;差分输出;航空429总线;环形队列功能相对独立的航空电子系统逐步走向综合,例如将雷达、惯导、GPS 和机载计算机联合,组成新型航空图导航系统,各子系统之间的数据通讯变得尤为重要。航空电子系统之间最常的通讯总线是ARINC429和1553B。其中 ARINC429广泛使用在波音(Boeing)系列飞机、欧洲空中客车(Airbus)等机种。我国的惯导系统也以ARINC429为主要通讯总线。一. ARINC429总线简介
2、ARINC429 规范,又称Mark33数字信息传输系统(DITS-Digital Information Transfer System),是专为航空电子系统通讯而规定的航空工业标准,解决了原来419规范的许多矛盾和冲突。它忽略了不同厂家航电系统接口的复杂性,为系统互联提供了统一平台。根据规范,数字信息通过一对单向、差分耦合、双绞屏蔽线传输,本质属于串行通讯范畴。数据以32-Bit字(Word)格式传送。每个字包含1-Bit校验位,8-Bit标号。标号(Label)定义了飞行数据的功能,即保持被传输数据的所属类型,例如属于精度数据、纬度数据等。其余的数据位或以数字(二进制或BCD编码),或以
3、字母编码,根据Label而区分成不同的域。为了使通讯完全标准化和防止冲突,所有的飞行功能都已经赋予了特定的标号和数据格式。ARINC429数据发送时经过二级差分驱动,如图1波形所示。前级V+、V-是TTL电平,即逻辑1为5V,逻辑0为0V的正逻辑。经过驱动的第二级输出V+、V-电平和参考电压VRef有关。而差分运算结果是参考电压的2倍。图1表示ARINC429逻辑“1”、“Null”空数据和逻辑“0”在差分双绞线上电平定义。在连续传送数据时,每个32-Bit字之间至少插入4个空(Null)状态进行隔离,亦即字间隙。字内格式定义如表1所示。注意,其位号从1开始,不是通常的从0开始的习惯。 表1
4、ARINC429 32-Bit字格式定义ARINC BIT#(数据位)Function (功能)备注1-8Label标号 域9-10SDI or Data数据源(Source)、目的(Destination)或 数据的一部分11LSB12-27Data28MSB29Sign数据的最低有效位30,31SSM数据32Parity Status数据的最高有效位二. HS3282芯片和ARINC429收发设计目前ARINC429 收发器以HARRIS公司的HS3282和HS3182最为著名,分别和Device Engineering公司的DEI1016及BD429完全兼容。HS3282是高性能的CMO
5、S型429接口,亦能满足类似的时分多路串行数据通讯。图2是其结构框图, 整个芯片只需单5V工作电源。它具有2路接收、一路发送。接收器和发送器相互独立,同时工作。双通道接收器之间也是独立的并行接收,可以直接连接到 ARINC429总线,而不需电平转换。数据字长可以是标准的32-Bit或25-Bit,接收数据时进行校验,而发送数据时产生校验。内部定时器可自动调整字间隙(Word Gap)。其发送缓冲是一个832Bit的FIFO。HS3282和CPU接口比较简单,发送时经常和HS3182配合。HS3182是满足ARINC429规范的、双极数据输入的线驱动器。这里不再详细介绍这两个芯片的管脚分配,如需
6、要可以参考图3。图3 是ARINC429总线收发的经典电路。复位是低电平有效,外部工作时钟为1MHz。具有二路接收,即第一路接收(Rx429A+,Rx429A-)和第二路接收(Rx429B+,Rx429B-),具有一路发送,即(Tx429+,Tx429-)。发送时,HS3282为前级输出,HS3182为正式差分输出。C2、C3为68pF的电容,这两个电容至关重要,最好采用高精度军品电容。一般作为CPU外围I/O设备的接口芯片,都有片选、读、写信号和选择片内寄存器的若干地址线。但HS3282有点特殊,每一个寄存器操作信号都需要对CPU信号进行译码产生。图4是对HS3282控制逻辑示意图。选择 C
7、PU时最好直接选择外部数据总线为16-Bit以上的,如MC80186、F240等。如果非要用8-Bit的CPU,则需要2个8-Bit的锁存器,一次将16-Bit先读写到锁存器中,然后分别对2个锁存器读写,硬件和软件都比较麻烦。控制逻辑以CPU提供的I/O操作信号/IS和读写信号/RD、 /WR以及地址A2A1为输入,为HS3282产生操作信号,诸如读第一路接收数据寄存器信号 /RD429A,第二路 /RD429B,发送低字选通信号 /WR429LW,高字 /WR429HW,发送使能控制 TX429EN等。控制逻辑和CPU同时监视HS3282的3个状态信号,第一路接收准备好信号 /Rx1RDY,
8、第二路/Rx2RDY,发送准备好/Tx429RDY。这些状态信号一方面可供软件查询,另一方面由控制逻辑产生 /INT中断请求。在图4 和下面的逻辑描述中都没有体现为CPU提供READY信号的要求。一般情况下,作为I/O外设的HS3282读写速度要比CPU慢,应该用一个状态机进行速度匹配,为CPU产生READY信号。表2是对图4控制逻辑电路地址的一种分配方法,并不是唯一的。在发送使能信号TX429EN控制中,简单地把发送准备好信号 /TX429RDY反相后输出。亦即只要HS3282发送器有空闲,就允许发送。HS3282的发送器包括一个FIFO,可以存储8个32-Bit的 429数据字。在要求爆发
9、式(Burst)发送时,可以把发送使能TX429EN直接由CPU控制。一般处于禁止状态,当CPU填充HS3282的发送 FIFO字数达到自定数目(如8个)时,再使能发送,使FIFO中数据倾泻而出。 表2 HS3282寄存器分配地址读操作 (Read)写操作(Write)有效信号00H第一路接收低字寄存器Rx429ALW/RD429A = L, (SEL=A0=0)01H第一路接收高字寄存器Rx429AHW/RD429A = L, (SEL=A0=1)02H第二路接收低字寄存器Rx429BLW/RD429A = L, SEL=A0=003H第二路接收高字寄存器Rx429BHW控制寄存器CR429
10、A/RD429B =L, (SEL=A0=1)04H发送低字寄存器Tx429ALW/WR429LW = L05H06H发送高字寄存器Tx429AHW/WR429HW = L其实现逻辑如下: IS,RD,WR pin; / CPU方的I/O操作、读写信号,皆为低有效. IOAddr = A2,A1,X; / CPU 方 I/O 地址 ENTX429A = !TX429ARDY; / ARINC429 发送使能. / 读 第一路 ARCIN429 接收寄存器 高低字. !RD429A = !IS & !RD & (IOAddr = RX429ALW) # (IOAddr = RX429AHW);
11、/ 读 第二路 ARCIN429 接收寄存器 高低字. !RD429B = !IS & !RD & (IOAddr = RX429BLW) # (IOAddr = RX429BHW); / 写 第一路 ARCIN429 发送寄存器 高低字. !WR429AL = !IS & !WR & (IOAddr = TX429ALW); !WR429AH = !IS & !WR & (IOAddr = TX429AHW); / 写 第一片 HS3282 控制寄存器. !WR429ACW = !IS & !WR & (IOAddr = CR429A); !INT = !RX1RDY # !RX2RDY;
12、/ 2路接收准备好,共享中断请求. 三. 软件设计上电复位后,软件应在正式工作前初始化HS3282,即向控制器写控制字。初始化时可以设置字长为32-Bit或25-Bit。外部提供的工作时钟为1MHz,内部接收和发送速率可以设置为十分之一或八十分之一,即100Kbps或12.5Kbps。也可以设置为自测试模式,即HS3282的发送直接在内部环接到第一路接收,反相接到第二路。发送数据,然后比较发送和接收,判断HS3282工作状况。自测试原理可以参考图1的框图。在此主要介绍正式工作时软件的一些功能算法。3.1 原始数据收发在图3和图4的硬件设计中已经考虑到软件设计的方便性。软件收发既可以采用查询HS
13、3282的状态位进行,也可以采用中断驱动。原始数据的收发是整个系统的瓶颈,一般实用程序都采用中断接收,查询式发送。其中断响应作为核心部分,一般都使用对应嵌入式CPU的汇编语言实现。为清楚起见,采用算法语言描述。中断接收数据首先存放到缓冲区,亦即环形队列中,再由主程序读取,其结构与算法如下:位置0123 N-2N-1内容RxNumWrPtrRdPtrData BufferEndAddr功能当前接收字数写指针读指针数据缓冲区结束地址 / 环形队列缓冲区初始化procedure InitBuf;begin Disable Interrupt; / 禁止中断 RxNum := 0; / 接收数目清0
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- 基于 HS3282 ARINC429 航空 通讯 总线 设计
