基于USB20MIT-BIH心电数据回放系统的设计.doc
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1、基于USB2.0MIT-BIH心电数据回放系统的设计 摘要:设计基于USB2.0的D/A转换模块,文中对模块的主要芯片、主要原理、接口函数及主要性能进行了介绍。通过取一心电数据通过vc编程将其进行D/A转换,输出波形与原始波形进行比较,较好的实现了回放功能。由此可见,该模块的性能指标达到了设计要求。心电数据回放很好的实现,为一系列心电算法的仿真实践及实时心电监护仪的研制打好了基础。关键词:USB2.0 ; D/A转换模块; MIT-BIH; 心电数据库 中图分类号:TP335+.4 R318.6 文献标志码:ADesign Of MIT-BIH ECG Datebase Redisplay S
2、ystem Based On USB 2.0 Abstract: This design is based on the D/A converter module of USB2.0 whose main chips, important principles, interface functions and major performance are introduced in this papers. With the VC program, we can get a better data redisplay after putting one of the ECG Databases
3、to the D/A converter and comparing the output waveform with the original one. Our work would be very useful for promoting a series of simulation practices of ECG calculations and the development of ECG Monitor.Keywords: USB2.0; D/A converter module; MIT-BIH; ECG Database0前言回放系统的设计包括硬件的设计及软件编程的实现两大部分
4、,在硬件系统设计中应用基于USB2.0协议的微控制器对其它芯片进行控制,在上位机的软件编程下实现MIT-BIH心电数据库的回放。所谓心电数据的回放就是将原有的存储的数字心电信号,根据其存储的格式,利用设计的系统通过D/A转换最终从终端回放出模拟信号。1 系统工作原理和硬件设计上位机预先对心电数据进行处理,然后通过USB总线不断向端点FIFO中发送12位数据,CY7C68013通过GPIF将内部端点FIFO中的数据连续不丢失的传递到外部高速缓存器FIFO中,DAC7613E在CPLD逻辑时序控制下对输入的信号进行数模转换。具体模块功能如图1所示。图1 高速数据回放系统结构框图Fig.1 high
5、-speed data Redisplay system structure diagram1.1 接口电路和D/A转换模块电路选用EZ-USB FX2系列中CY7C68013作为数据传输的接口芯片,其GPIF引擎具有自动传输数据特性,使外围设备和主机通过CY7C68013可以无缝,高速地传输数据。其核心是一个可编程状态机,负责将端点FIFO与外设FIFO进行逻辑连接,控制数据的读写操作,实现由硬件来完成数据的自动传输。CY7C68013内部CPU只起到下载固件代码以及在固件中触发GPIF的作用,不参与USB数据的传输。FX2这种独创性结构可使数据传输率达到56MB/s,极大地提高了传输速率。
6、最大限度地利用了USB的带宽。CY7C68013有以下主要特征: (1) 软件。8051从下载到内部RAM的程序开始运行,这个特征允许固件程序通过主机下载到芯片内部RAM中,从而方便了调试和固件的改写。 (2) 四个可编程。BULK/INTERRUPT/ISOCHRO-NOUS端点,可以是双缓冲区,三缓冲区或者四缓冲区,这样可以根据外部数据的速率调整缓冲区的宽度和深度,以适应不同的需要。(3) GPIF。允许直接连接到大多数并行接口:8位和16位;由可编程波形描述符和配置寄存器来定义波形;支持多个Ready(RDY)输入和Control(CTL)输出。DAC7613E是由BURR-BROWN公
7、司生产的一种12位数字信号输入,1路信号输出的数模转换器,在一定的温度范围输出稳定。DAC7613E接收12位并行输入数据,拥有双重缓冲的DAC逻辑输入输出,建立时间为10s。DAC7613E在双极性特性中输入范围为000H-800H输出为-2.5-0V,输入范围为800H-FFFH时输出为0-2.5V;在单极性特征中输入范围为000H-800H,输出范围为0-5V。如图2为DAC7613E在双极性状态下的工作电路。图2 DAC7613E在双极性状态下的工作电路Fig. 2 DAC7613E in bipolar state of circuit高速FIFO选用CY7C4265,它是16位16
8、k的异步FIFO。如图2所示,GPIF的数据线FD11:0与FIFO的输入数据线D11:0相连;GPIF的控制信号CTL0与FIFO的写信号线相连,当为低时,GPIF可以在每个时钟IFCLK的上升沿向FIFO中写入1个数据;FIFO的负信号线、输出允许信号线受CPLD控制,当和为低时,DAC7615E也可以在时钟RCLK的上升沿从FIFO中读取一个数据。图3 接口电路和D/A转换模块Fig. 3 interface circuit and D / A converter module2 系统软件设计2.1 CPLD逻辑控制程序设计选用Verilog HDL语言来描述CPLD(XC95144XL
9、)的逻辑控制时序。CPLD完成的功能如下:一是产生外部FIFO的读时钟信号及DAC7615E的转换时钟信号;二是接收上位机命令对DAC7615E的启动和停止进行控制;三是通过编程对D/A转换时序进行控制。2.2 FX2固件程序的设计固件是运行于USB设备中的程序代码,用于辅助硬件完成USB的功能。主要完成如下功能:一是处理USB标准请求和用户自定义请求;二是根据USB规范设置设备的各种描述符;三是初始化系统得各级中断和内部端点的配置;通过EZ-USB FX2 提供了Keil C51编译环境下编写固件程序的框架,利用现成固件程序框架函数,根据设备需求添加相应的用户代码,完成特定目的。固件框架如图
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